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Dieser Artikel ist Teil einer ausführlichen Anleitung dazu, wie wir mit Quilters physikgestützter Layout-Automatisierung einen Computer auf Basis des NXP i.MX 8M Mini nachgebaut haben.
Eine vierstündige Sitzung kann ein sinnvoller Zeitrahmen sein, um einen KI-gestützten PCB-Layout-Ablauf zu erproben. Sie verspricht nicht, einen beliebigen Schaltplan in vier Stunden fertigungsreif zu machen. Ziel ist eine dokumentierte Entscheidung: einen Kandidaten weiter verifizieren, Eingaben überarbeiten oder eine ungeklärte Randbedingung zuerst bearbeiten.
Vor dem Start vorbereiten
Mit geprüftem Schaltplan, kontrollierten Footprints, festgelegter Platinenkontur und mechanischen Einschränkungen beginnen. Einen fertigbaren Lagenaufbau und Designregeln mit dem Fertigungspartner abstimmen. Steckverbinderpositionen, kritische Schaltungen, Testzugang und zu erhaltende Leiterbahnen dokumentieren. Vorbereitung kostet Zeit; sie getrennt ausweisen, statt sie aus dem Projektgesamtaufwand auszublenden.
Ein vorgeschlagener Ablauf über 240 Minuten
- 30 Minuten: Eingaben prüfen. Verbindungen, Einheiten, Bibliotheken, Kontur und getestete Revision kontrollieren.
- 30 Minuten: Randbedingungen und Start. Unterstützte Designparameter bestätigen und Auftragskonfiguration dokumentieren.
- 90 Minuten: Generierungsfenster. Auftrag beobachten und Laufzeit erfassen. Dies ist ein Planungsbudget, keine erwartete oder garantierte Fertigstellungszeit.
- 45 Minuten: Kandidaten prüfen. Platzierung, Routing, offene Verbindungen und kritische Bereiche anhand der vereinbarten Abnahmekriterien bewerten.
- 45 Minuten: native CAD-Prüfungen und nächste Entscheidung. Kandidaten importieren, erforderliche Prüfungen durchführen und Restarbeit dokumentieren.
Die Budgets ergeben vier Stunden. Läuft der Auftrag noch, besteht ein Kandidat die Prüfung nicht oder dauert eine Untersuchung länger, den Terminplan erweitern und den Grund festhalten. Erforderliche Verifikation nicht dem Zeitrahmen unterordnen.
Freigabekriterien statt eines reinen Routing-Meilensteins
Ein gerouteter Kandidat ist ein Zwischenstand. Vor der Freigabe Schaltplan-Layout-Konsistenz, offene Regelverletzungen, mechanische Passung und Fertigungsdaten prüfen. Erforderliche Analysen zu Signal- und Leistungsintegrität, Temperatur und Sicherheit durchführen. Die für das Produkt nötigen Entwicklungs- und Fertigungsfreigaben einholen.
Ein bestandener DRC ist ein hilfreicher Nachweis, bestätigt aber nicht jede elektrische oder produktbezogene Anforderung. Genehmigte Ausnahmen mit Verantwortlichem und Begründung dokumentieren; offene Fehler nicht als fertigungsreif bezeichnen.
Die nächste Schätzung verbessern
Vorbereitung, aktive Entwicklungsarbeit, automatisierte Laufzeit, Nachbearbeitung und verbleibende Verifikation getrennt erfassen. Quilter erzeugt Layoutkandidaten für die Prüfung im bestehenden CAD-Ablauf. Vor der Pilotwahl die unterstützten Designparameter prüfen. Ergebnis der Sitzung sollte eine belegbare Schätzung für die tatsächliche Platine sein, einschließlich der Arbeit nach dem vierstündigen Fenster.

























