Glossar zum PCB-Design

Altium Designer ist eine führende Plattform für Schaltplanerfassung, Leiterplattenlayout, MCAD-Integration und Lieferkettenwerkzeuge, die von Hardwareentwicklern eingesetzt wird.

Das Aspektverhältnis im Leiterplattendesign ist das Verhältnis zwischen Tiefe und Durchmesser einer Via. Dieser wichtige Fertigungsparameter bestimmt die Zuverlässigkeit der Via und ihre Herstellbarkeit.

Ein Autorouter ist ein Softwarewerkzeug, das automatisch Leiterbahnverbindungen zwischen Leiterplattenbauteilen erstellt. Herkömmliche Autorouter berücksichtigen physikalische Zusammenhänge jedoch häufig unzureichend und erfordern umfangreiche manuelle Nacharbeit.

Backdrilling ist ein Verfahren zur Leiterplattenfertigung, bei dem ungenutzte Via-Stubs entfernt werden, um Signalreflexionen zu verringern und die Hochgeschwindigkeitseigenschaften mehrlagiger Leiterplatten zu verbessern.

Bei der Bauteilplatzierung werden elektronische Komponenten auf einer Leiterplatte so angeordnet, dass Signalintegrität, thermisches Verhalten, Herstellbarkeit und Routingeffizienz optimiert werden.

Der Bestückungsdruck ist die aufgedruckte Text- und Symbollage auf der Leiterplattenoberfläche. Sie enthält Bauteilreferenzen, Polaritätsmarkierungen und Bestückungsinformationen für Fertigung und Fehlersuche.

BGA-Fanout bezeichnet die Routingstrategie, mit der Signalleiterbahnen aus dem dichten Anschlussraster eines Ball-Grid-Array-Gehäuses zu äußeren Routingkanälen und Vias herausgeführt werden.

Eine Blind Via verbindet eine Außenlage einer Leiterplatte mit einer oder mehreren Innenlagen, ohne die gesamte Leiterplatte zu durchdringen. Dadurch ermöglicht sie eine höhere Routingdichte in komplexen Designs.

Eine Buried Via verbindet zwei oder mehr Innenlagen einer Leiterplatte, ohne eine der Außenflächen zu erreichen. Dadurch maximiert sie die Routingdichte in Designs mit vielen Lagen.

Ein Bypass-Kondensator (Entkopplungskondensator) wird nahe an den Versorgungsanschlüssen eines ICs auf der Leiterplatte platziert, um hochfrequente Störungen zu filtern und lokale Ladungsreserven für eine stabile Stromversorgung bereitzustellen.

Cadence Allegro ist eine Leiterplattenentwicklungsplattform für Unternehmen, die für besonders komplexe, mehrlagige Hochgeschwindigkeitsdesigns in der Luft- und Raumfahrt, der Netzwerktechnik und der Halbleiterindustrie eingesetzt wird.

DDR-Routing bezeichnet das Layout von DDR-Speicherschnittstellen auf einer Leiterplatte. Für eine zuverlässige Hochgeschwindigkeitsdatenübertragung sind präziser Längenabgleich, Timingvorgaben und Impedanzkontrolle erforderlich.

Designwiederverwendung bedeutet, bewährte Schaltungsblöcke, Layouts und Bauteilbibliotheken aus früheren Leiterplattendesigns zu nutzen, um die Entwicklung neuer Produkte zu beschleunigen.

Die Dielektrizitätskonstante ist eine Materialeigenschaft des Leiterplattensubstrats, die Signalausbreitungsgeschwindigkeit und Wellenwiderstand bestimmt und damit die Leistungsfähigkeit von Hochgeschwindigkeitsdesigns unmittelbar beeinflusst.

Differenzielle Leitungspaare sind zwei parallel geführte Leiterbahnen mit komplementären Signalen. Sie werden in Hochgeschwindigkeitsschnittstellen wie USB, HDMI und Ethernet eingesetzt, um Störungen zu reduzieren und die Signalintegrität zu verbessern.

Eine durchkontaktierte Bohrung ist ein gebohrtes und mit Kupfer metallisiertes Via, das elektrische Verbindungen zwischen allen Lagen einer Leiterplatte ermöglicht. Sie ist der häufigste Via-Typ in der Leiterplattenfertigung.

Die Durchsteckmontage ist ein Bestückungsverfahren, bei dem Bauteilanschlüsse durch Bohrungen in der Leiterplatte gesteckt und verlötet werden. Sie bietet stabile mechanische Verbindungen für Steckverbinder und Leistungsbauteile.

EDA-Software (Electronic Design Automation) umfasst Werkzeuge, mit denen Ingenieure elektronische Systeme entwerfen, simulieren und prüfen, darunter Leiterplattenlayout, Schaltplanerfassung und SPICE-Simulation.

Eingebettete Bauteile sind passive oder aktive elektronische Komponenten, die innerhalb der Substratlagen einer Leiterplatte statt auf ihrer Oberfläche liegen. Sie verringern die Leiterplattengröße und verbessern das Hochfrequenzverhalten.

Eine elektrische Regelprüfung validiert Verbindungen und elektrische Korrektheit auf Schaltplanebene und erkennt Verdrahtungsfehler, bevor das Design in das Leiterplattenlayout übergeht.

Die elektromagnetische Simulation nutzt numerische Verfahren, um das Verhalten elektrischer und magnetischer Felder auf einer Leiterplatte vorherzusagen und Signalintegrität, EMV-Verhalten und Antenneneigenschaften zu validieren.

EMI (elektromagnetische Störungen) und EMV (elektromagnetische Verträglichkeit) betreffen im PCB-Design die Begrenzung unerwünschter elektromagnetischer Emissionen und den Betrieb von Schaltungen ohne Störung anderer Systeme.

ENIG (Electroless Nickel Immersion Gold) ist ein verbreitetes Leiterplattenfinish mit ebenen, lötbaren Pads, hoher Lagerfähigkeit und Eignung für Bauteile mit feinem Anschlussraster.

Eine Entkopplungsstrategie ist ein systematischer Plan für die Auswahl, Platzierung und Anbindung von Bypass-Kondensatoren auf einer Leiterplatte, um alle aktiven Bauteile störungsarm mit Strom zu versorgen.

Eine Entwurfsregelprüfung (Design Rule Check, DRC) ist ein automatisiertes Prüfverfahren, das ein Leiterplattenlayout vor der Fertigung auf Verstöße gegen Fertigungs- und elektrische Randbedingungen untersucht.

Ethernet-PCB-Design umfasst die Layoutanforderungen kabelgebundener Netzwerkschnittstellen von 100BASE-T bis 100G Ethernet, einschließlich Übertragerplatzierung, Impedanzkontrolle und EMV-Konformität.

Fertigungsgerechtes Design (Design for Manufacturability, DFM) umfasst Verfahren für das Leiterplattendesign, die eine zuverlässige Fertigung, Bestückung und Prüfung in Serie ohne Fehler oder Ausbeuteverluste sicherstellen.

Fiber-Weave-Effekt: Skew durch den Dk-Unterschied von Glas und Harz im Laminat. Warum er je Leiterplatte variiert und wie Sie ihn mit dem Hersteller senken.

Eine flexible Leiterplatte basiert auf biegsamem Polyimid und passt sich gekrümmten Gehäusen an. Sie ermöglicht kompakte Designs für Wearables, Medizingeräte und die Luft- und Raumfahrt.

Beim Flying-Probe-Test bewegen sich motorisierte Prüfspitzen über die Leiterplatte und prüfen Verbindungen und Isolation, ohne dass ein individueller Prüfadapter erforderlich ist.

FR-4 ist das am häufigsten verwendete glasfaserverstärkte Epoxidlaminat für Leiterplatten und verbindet elektrische Isolation, mechanische Festigkeit und Wirtschaftlichkeit.

Gerber-Dateien sind das branchenübliche Format zur Übergabe von Leiterplattendesigndaten an Fertiger. Sie definieren Kupferlagen, Lötstoppmaske, Bestückungsdruck und Bohrmuster.

Goldfinger sind vergoldete Randkontaktflächen einer Leiterplatte. Sie bilden eine zuverlässige, korrosionsbeständige Kontaktoberfläche zum Einstecken in einen passenden Kartenrandsteckverbinder.

Halblochkontakte sind halbierte metallisierte Vias am Rand eines Leiterplattenmoduls. Sie ermöglichen es, das Modul wie ein oberflächenmontiertes Bauteil auf eine Trägerleiterplatte zu löten.

HDI-Leiterplatten (High Density Interconnect) nutzen Microvias, feine Leiterbahnen und fortschrittliche Lagenstrukturen für maximale Routing-Dichte in kompakter, leistungsfähiger Elektronik.

HF-PCB-Design ist das spezialisierte Layout von Schaltungen, die mit Hochfrequenzsignalen arbeiten. Es erfordert präzise Impedanzkontrolle, Abschirmung und die gezielte Beherrschung elektromagnetischer Effekte.

High-Speed-PCB-Design ist eine spezialisierte Disziplin, die sich mit Signalintegrität, Timing und elektromagnetischen Effekten in Schaltungen mit Datenraten im Gigabit-pro-Sekunde-Bereich befasst.

Eine Impedanzfehlanpassung entsteht, wenn sich der Wellenwiderstand einer Leiterbahn entlang ihres Verlaufs ändert. Dadurch entstehen Signalreflexionen, die die schnelle Datenübertragung beeinträchtigen.

Impedanzkontrolle bedeutet, Leiterbahnen auf einen bestimmten Wellenwiderstand auszulegen. Sie ist entscheidend für schnelle Signalübertragung und geringe Reflexionen.

Eine impedanzkontrollierte Leiterplatte wird mit festgelegten Leiterbahngeometrien und Toleranzen des Lagenaufbaus gefertigt, um die von Hochgeschwindigkeitsschnittstellen geforderten Wellenwiderstände zu erreichen.

Ein Impedanzrechner ermittelt aus Lagengeometrie und dielektrischen Eigenschaften die erforderliche Leiterbahnbreite für einen vorgegebenen Wellenwiderstand.

Kantenmetallisierung ist ein Verfahren zur Leiterplattenfertigung, bei dem eine leitfähige Kupferschicht auf den Leiterplattenrand aufgebracht wird. Sie dient der Masseanbindung, Abschirmung und Herstellung von Halblochverbindungen.

KiCad ist eine kostenlose, quelloffene PCB-Designsuite mit professioneller Schaltplanerstellung, Layoutgestaltung und Fertigungsdatenausgabe ohne Lizenzkosten.

Eine Kupferfüllfläche ist ein großflächiger Kupferbereich auf einer Leiterplattenlage, der meist als Masse- oder Versorgungsfläche dient und Abschirmung, Wärmeabfuhr und die Qualität der Rückstrompfade verbessert.

Das Kupfergewicht gibt die Dicke der Kupferfolie auf jeder Leiterplattenlage an. Es wird in Unzen pro Quadratfuß gemessen und beeinflusst Strombelastbarkeit, Leiterbahnbreite und thermisches Verhalten.

Die Lagenzuordnung legt fest, welche Signaltypen auf welchen Kupferlagen verlaufen, um Signalintegrität, Übersprechisolation und Routing-Effizienz zu optimieren.

Beim Längenabgleich werden Leiterbahnen einer Signalgruppe auf gleiche Länge gebracht, damit Signale gleichzeitig ankommen. Das ist für schnelle parallele Busse und DDR-Schnittstellen entscheidend.

Leiterbahn-Routing ist das Zeichnen von Kupferpfaden auf einer Leiterplatte, um die im Schaltplan definierten elektrischen Verbindungen zwischen Bauteilen herzustellen.

Bei der Leiterplattenbestückung werden elektronische Bauteile auf eine gefertigte Leiterplatte gelötet. So wird aus einer unbestückten Platine eine funktionsfähige elektronische Baugruppe.

Die Leiterplattenfertigung stellt aus Rohmaterialien eine unbestückte Leiterplatte her. Dazu gehören Kupferätzen, Bohren, Metallisieren und Laminieren.

Der Lagenaufbau einer Leiterplatte definiert die Anordnung von Kupfer- und Isolierschichten und beeinflusst unmittelbar Impedanz, Signalintegrität, Stromversorgung und Fertigungskosten.

Beim Leiterplattenlayout werden elektronische Bauteile auf einer Leiterplatte räumlich angeordnet und verbunden. So wird ein Schaltplan in ein herstellbares Design umgesetzt.

Beim Leiterplatten-Prototypenbau wird eine kleine Stückzahl an Leiterplatten gefertigt und bestückt, um ein Design vor der Entscheidung für die vollständige Produktion zu validieren.

Ein Leiterplatten-Respin ist eine Designrevision, die eine erneute Fertigung erfordert. Auslöser sind meist Funktionsfehler, Fertigungsprobleme oder Bauteiländerungen, die nach dem ersten Aufbau erkannt werden.

Eine Lotpastenschablone ist ein dünnes Metallblech mit lasergeschnittenen Öffnungen. Sie dient dazu, vor der Bestückung mit oberflächenmontierbaren Bauteilen präzise Lotpastendepots auf die Leiterplattenpads aufzutragen.

Die Lötstoppmaske ist die schützende Polymerschicht über den Kupferleiterbahnen einer Leiterplatte. Sie verhindert Lötbrücken, schützt vor Oxidation und legt die lötbaren Bereiche fest.

Eine Massefläche ist eine durchgängige Kupferfläche auf einer Leiterplatte für das Massepotenzial. Sie bietet niederimpedante Rückstrompfade, elektromagnetische Abschirmung und Wärmeabfuhr.

Eine Microstrip-Leitung ist eine Übertragungsleitung auf einer äußeren Leiterplattenlage mit benachbarter Massefläche als Referenz. Sie wird häufig für impedanzkontrolliertes Routing verwendet.

Ein Microvia ist eine lasergebohrte Durchkontaktierung mit kleinem Durchmesser zwischen benachbarten Leiterplattenlagen. Sie ist für HDI-Designs mit BGA-Bauteilen im Feinraster unverzichtbar.

Mixed-Signal-PCB-Design verbindet analoge und digitale Schaltungen auf einer Platine und bewältigt dabei die besondere Herausforderung, Störkopplung zwischen beiden Bereichen zu verhindern.

Multi-Board-Design entwickelt verbundene Leiterplattenbaugruppen, deren Platinen in einem System zusammenarbeiten. Dafür müssen Steckverbinderplatzierung und Signalführung koordiniert werden.

Eine Netzklasse fasst Leiterplattennetze mit gemeinsamen Designregeln wie Leiterbahnbreite, Abstand und Zielimpedanz zusammen und vereinfacht die Verwaltung von Randbedingungen komplexer Designs.

Eine Netzliste ist eine Datendatei, die sämtliche elektrischen Verbindungen zwischen Bauteilanschlüssen eines Leiterplattendesigns definiert. Sie bildet die Brücke zwischen Schaltplan und physischem Layout.

Bei der Nutzenaufteilung werden mehrere Leiterplattendesigns oder Exemplare auf einem gemeinsamen Fertigungsnutzen angeordnet, um die Fertigungseffizienz zu optimieren, Kosten zu senken und die Bestückung zu vereinfachen.

Die Oberflächenmontagetechnik ist das vorherrschende Verfahren zur Leiterplattenbestückung. Dabei werden Bauteile direkt auf die Leiterplattenoberfläche gelötet, statt ihre Anschlüsse durch Bohrungen zu führen.

ODB++ ist ein intelligentes Datenaustauschformat für Leiterplatten, das vollständige Design- und Fertigungsinformationen in einer strukturierten Datenbank bündelt und herkömmliche Gerber-Dateipakete ersetzt.

Passermarken sind Referenzpunkte aus Kupfer auf einer Leiterplatte, mit denen automatische Bestückungsanlagen die Platine für eine präzise Bauteilplatzierung ausrichten.

Ein PCB-Footprint (Land Pattern) definiert die Anordnung und Abmessungen der Kupferpads auf einer Leiterplatte, die zum Gehäuse eines bestimmten Bauteils passen und dessen Verlötung ermöglichen.

PCB-Komplettfertigung ist ein umfassendes Fertigungsmodell, bei dem ein einziger Anbieter sämtliche Schritte von der Leiterplattenherstellung und Bauteilbeschaffung bis zur Bestückung und Prüfung übernimmt.

PCIe-Routing ist der spezialisierte PCB-Layoutprozess für serielle PCI-Express-Hochgeschwindigkeitsschnittstellen. Er erfordert präzise Impedanzkontrolle, die Führung differenzieller Paare und die Platzierung von AC-Koppelkondensatoren.

Pick-and-Place ist der automatisierte Fertigungsprozess, bei dem Bestückungsautomaten oberflächenmontierbare Bauteile mit hoher Geschwindigkeit auf die Lotpastendepots der Leiterplattenpads setzen.

Prepreg: Glasgewebe in teilausgehärtetem Harz, das Leiterplattenlagen verbindet. Prepreg vs. Core, IS400-Dicken und warum Sie die Pressdicke beim Hersteller prüfen.

Prüfgerechtes Design (Design for Test, DFT) umfasst Verfahren für das Leiterplattendesign, die eine effiziente Prüfung während der Fertigung sowie eine automatisierte Fehlererkennung und Qualitätskontrolle ermöglichen.

Reflow-Löten ist der wichtigste Bestückungsprozess für Leiterplatten. Dabei wird Lotpaste in einem Ofen mit kontrolliertem Temperaturprofil erhitzt, um oberflächenmontierbare Bauteile dauerhaft mit der Leiterplatte zu verbinden.

Reinforcement Learning ist eine im PCB-Design eingesetzte KI-Technik, bei der Algorithmen durch das iterative Durchlaufen von Millionen Entwurfsvarianten optimale Platzierungs- und Routingstrategien erlernen.

Ein Restring ist die Kupferfläche eines Pads um eine gebohrte Via oder Durchkontaktierung auf einer Leiterplatte. Er ist entscheidend für zuverlässige elektrische Verbindungen und eine hohe Fertigungsausbeute.

Die Routingdichte beschreibt, wie viel der verfügbaren Routingfläche einer Leiterplatte durch Leiterbahnen belegt ist. Sie ist eine zentrale Kennzahl dafür, ob sich ein Entwurf innerhalb der gegebenen Leiterplattenfläche und Lagenzahl fertigstellen lässt.

Ein Rückstrompfad ist der Weg, auf dem der Signalstrom über die Masse- oder Versorgungsfläche einer Leiterplatte zu seiner Quelle zurückfließt. Er ist entscheidend für Signalintegrität und EMI-Verhalten.

Schaltplanerfassung ist die Erstellung des elektronischen Schaltplans, der sämtliche Bauteile und ihre elektrischen Verbindungen festlegt, bevor das PCB-Layout beginnt.

Eine Schutzbeschichtung ist eine schützende Polymerschicht auf bestückten Leiterplatten, die Bauteile und Leiterbahnen vor Feuchtigkeit, Staub, Chemikalien und extremen Temperaturen abschirmt.

Signalintegrität bezeichnet die Qualität elektrischer Signale auf ihrem Weg über Leiterbahnen einer Leiterplatte. Sie stellt sicher, dass Daten ohne Verzerrungen, Störungen oder Timingfehler am Ziel ankommen.

Ein Spannungsreglermodul ist eine Komponente zur Leistungswandlung auf einer Leiterplatte. Es senkt die Eingangsspannung auf die präzisen Werte ab, die Prozessoren, FPGAs und andere digitale ICs benötigen.

Eine Sperrfläche ist ein definierter Leiterplattenbereich, in dem Bauteile, Leiterbahnen, Vias oder Kupfer eingeschränkt sind, um Störungen zu vermeiden, Abstände einzuhalten oder mechanische Vorgaben zu erfüllen.

Die SPICE-Simulation ist das branchenübliche Verfahren zur Vorhersage des Schaltungsverhaltens. Sie modelliert Bauteileigenschaften und elektrische Wechselwirkungen mathematisch, bevor physische Prototypen gebaut werden.

Eine Starrflex-Leiterplatte vereint starre und flexible Leiterplattenbereiche in einer einzigen Struktur. Sie ersetzt Steckverbinder und Kabel und ermöglicht kompakte, zuverlässige Baugruppen mit mehreren Leiterplattenbereichen.

Eine Stripline ist eine Übertragungsleitung auf einer Leiterplatte, bei der die Leiterbahn zwischen zwei Referenzflächen verläuft. Gegenüber Microstrip bietet sie eine bessere Abschirmung und geringeres Übersprechen.

Die Strombelastbarkeit bezeichnet den maximalen Strom, den eine Leiterbahn sicher führen kann, ohne Temperaturgrenzen zu überschreiten. Sie wird durch Leiterbahnbreite, Kupferdicke und thermische Umgebung bestimmt.

Das Stromversorgungsnetzwerk ist das vollständige System aus Kupferflächen, Leiterbahnen, Vias und Kondensatoren, das eine störungsarme, stabile Spannung von den Reglern zu jedem Bauteil einer Leiterplatte liefert.

Eine Stückliste (Bill of Materials, BOM) ist die vollständige Liste aller Bauteile, die zur Herstellung einer bestückten Leiterplatte benötigt werden, einschließlich Teilenummern, Mengen, Werten und Lieferanteninformationen.

Die Taktverteilung ist eine Aufgabe des Leiterplattendesigns: Taktsignale müssen zu allen benötigten Bauteilen geführt werden, wobei Timinggenauigkeit, Signalintegrität und ein möglichst geringer Taktversatz gewahrt bleiben.

Ein Testpunkt ist eine festgelegte Stelle auf einer Leiterplatte, die Zugang zu einem Schaltungsknoten für elektrische Messungen, Fehlersuche und automatisierte In-Circuit-Tests bietet.

Ein thermisches Via ist eine durchkontaktierte Bohrung unter wärmeerzeugenden Bauteilen. Es leitet Wärme vom Bauteilpad durch die Leiterplatte zu inneren Kupferflächen oder zur gegenüberliegenden Oberfläche.

Time-to-Market bezeichnet in der Hardwareentwicklung die gesamte Zeit vom ersten Entwurfskonzept bis zur Verfügbarkeit des Produkts. Das PCB-Layout ist dabei häufig der Engpass auf dem kritischen Pfad.

Der Tombstone-Effekt ist ein Bestückungsfehler, bei dem sich ein kleines oberflächenmontiertes Bauteil beim Reflow-Löten einseitig aufrichtet. Ungleichmäßige thermische oder Lötbedingungen verursachen dabei eine offene Verbindung.

Übersprechen ist die unerwünschte Kopplung elektromagnetischer Energie zwischen benachbarten Leiterbahnen. Sie verursacht Signalverzerrungen und Störungen, die in Hochgeschwindigkeitsdesigns zu Datenfehlern führen können.

Eine Übertragungsleitung ist eine Leiterbahn, die als Struktur mit kontrollierter Impedanz behandelt werden muss, wenn sich die Signalwellenlänge der Leiterbahnlänge nähert. Dies betrifft alle digitalen Hochgeschwindigkeitsentwürfe.

USB-Routing umfasst die Anforderungen an das PCB-Layout für Universal-Serial-Bus-Schnittstellen, darunter Impedanzkontrolle, die Führung differenzieller Paare und die Berücksichtigung der Steckerbelegung.

Eine Versorgungsfläche ist eine eigene Kupferlage im PCB-Lagenaufbau, die Versorgungsspannung an die Bauteile verteilt und eine niederimpedante Stromversorgung auf der gesamten Leiterplatte ermöglicht.

Versorgungsintegrität bezeichnet die Sicherstellung einer stabilen, störungsarmen Stromversorgung auf einer Leiterplatte. Dazu werden Spannungsabfälle, Störungen und Impedanzen minimiert, die Fehlfunktionen der Schaltung verursachen können.

Via-in-Pad ist eine PCB-Designtechnik, bei der Vias direkt innerhalb der Bauteilpads platziert werden. Sie ermöglicht kürzere Leiterbahnen und dichteres Routing bei Fine-Pitch-Bauteilen.